嵌入式培训

 
上海报名热线:021-51875830
北京报名热线:010-51292078
深圳报名热线:0755-61280252
南京报名热线:4008699035
武汉报名热线:027-50767718
成都报名热线:028-68802075
研发与生产 脱产就业培训基地
3G通信 企业培训 
  首 页   课程介绍   培训报名  企业培训   付款方式   讲师介绍   学员评价   关于我们   联系我们  承接项目 开发板商城  论坛
嵌入式协处理器--FPGA
FPGA项目实战系列课程----
嵌入式OS--3G手机操作系统
嵌入式协处理器--DSP
手机/网络/动漫游戏开发
嵌入式OS-Linux
嵌入式CPU--ARM
嵌入式OS--WinCE
单片机培训
嵌入式硬件设计
Altium Designer Layout高速硬件设计
嵌入式OS--VxWorks
PowerPC嵌入式系统/编译器优化
PLC编程/变频器/数控/人机界面 
开发语言/数据库/软硬件测试
3G手机软件测试、硬件测试
芯片设计/大规模集成电路VLSI
云计算、物联网
开源操作系统Tigy OS开发
小型机系统管理
其他类
WEB在线客服
武汉、南京在线WEB客服
点击这里给我发消息  
QQ客服一
点击这里给我发消息  
QQ客服二
点击这里给我发消息
QQ客服三
公益培训通知与资料下载
企业招聘与人才推荐(免费)

合作企业新人才需求公告

◆招人、应聘、人才合作
请访问曙海旗下网站---

电子人才网
www.morning-sea.com.cn
合作伙伴与授权机构
现代化的多媒体教室
曙海集团招聘启示
曙海动态
邮件列表
 
 
      大型RISC处理器设计培训班
   入学要求

        学员学习本课程应具备下列基础知识:
        ◆ 电路系统的基本概念。

   班级规模及环境
       为了保证培训效果,增加互动环节,我们坚持小班授课,每期报名人数限5人,多余人员安排到下一期进行。
   上课时间和地点
上课地点:【上海总部】:同济大学(沪西)/星河世纪广场(11号线上海西站) 【深圳分部】:电影大厦(地铁一号线大剧院站)/深圳大学成教院 【北京分部】:北京中山/福鑫大楼 【南京分部】:金港大厦(和燕路) 【武汉分部】:凯盟大厦(新华路) 【成都分部】:四威大厦(泰安里营门口路)
近开课时间(周末班/连续班/晚班)
大型RISC处理器设计培训班:2012年7月7日....
   学时
     ◆课时: 共8天,64学时

        ◆外地学员:代理安排食宿(需提前预定)
        ☆合格学员免费颁发相关资格证书,提升您的职业资质
        作为早专注于嵌入式培训的专业机构,曙海嵌入式提供的证书得到本行业的广泛认
        可,学员的能力得到大家的认同

        ☆合格学员免费推荐工作
        ★实验设备请点击这儿查看★
   新优惠
       ◆团体报名优惠措施:两人95折优惠,三人或三人以上9折优惠 。注意:在读学生凭学生证,即使一个人也优惠500元。
   质量保障

        1、培训过程中,如有部分内容理解不透或消化不好,可免费在以后培训班中重听;
        2、培训结束后免费提供一个月的技术支持,充分保证培训后出效果;
        3、培训合格学员可享受免费推荐就业机会。

        大型RISC处理器设计培训班
第1章 概述
第2章 VLSI电路设计
  2.1 工艺技术基础和电路设计风格
  2.2 设计流程
  2.3 设计阶段划分
第3章 RISC处理器体系结构
  3.1 简单的RISC处理器
  3.2 处理器体系结构的选择
   3.2.1 体系结构扩展技术
   3.2.2 方案评估
   3.2.3 设计方案技术小结
第4章 Verilog 简短介绍
第5章 外部行为描述
  5.1 RISC处理器如何工作
   5.1.1 汇编器
   5.1.2 测试板
  5.2 指令集
   5.2.1 LD/ST类装载和存储指令
   5.2.2 CTR类跳转指令
   5.2.3 ALU类算术和逻辑指令
   5.2.4 特殊类指令
   5.2.5 综合指令
   5.2.6 中断
  5.3 基于Verilog HDL建模的指令解释器
   5.3.1 概述
   5.3.2 组织结构
   5.3.3 应用
  5.4 测试方案详细说明书
  5.5 定量描述
第6章 处理器粗略结构的内部描述
  6.1 数据流
   6.1.1 指令在数据通路中的执行
   6.1.2 数据通路的流水线
   6.1.3 流水线执行方式的特性
  6.2 时序
   6.2.1 简单的时钟方案
   6.2.2 总线协议
  6.3 流水线级
   6.3.1 流水线级的命名和设计
   6.3.2 取指令级IF
   6.3.3 指令译码级ID
   6.3.4 执行级EX
   6.3.5 存储器访问级MA
   6.3.6 回写级WB
   6.3.7 流水线各级任务总结
  6.4 Cache和寄存器堆
   6.4.1 多功能Cache MPC
   6.4.2 跳转目的Cache
   6.4.3 流水线中MPC和BTC的协同
   6.4.4 寄存器堆
  6.5 中断的处理
第7章 粗略结构模型的流水线划分
  7.1 处理器CHIP
  7.2 取指令单元IFU
   7.2.1 I_BUS多选器
   7.2.2 IFU_ADDR_BUS多选器
   7.2.3 NPC_BUS多选器
   7.2.4 跳转目的Cache BTC
   7.2.5 多功能Cache MPC
   7.2.6 跳转决策逻辑BDL
   7.2.7 程序计数计算器PCC
   7.2.8 流水级禁止逻辑PDL
   7.2.9 指令译码逻辑IDL
   7.2.10 串行模式控制器 SMC
   7.2.11 扩展PC逻辑EPL
  7.3 指令译码单元IDU
   7.3.1 译码块DG1 
   7.3.2 译码块DG2
   7.3.3 译码块DG3
   7.3.4 译码块DG4
   7.3.5 译码块DG5
   7.3.6 译码块DG6
  7.4 算术逻辑单元ALU
   7.4.1 算术单元模型
   7.4.2 LOGIC模型
   7.4.3 SHIFT模型
  7.5 存储器访问单元MAU
  7.6 前推和寄存器单元FRU
   7.6.1 寄存器地址译码器RAC
   7.6.2 前推比较器CMP 
   7.6.3 前推选择逻辑FSL
   7.6.4 寄存器访问逻辑RAL
   7.6.5 数据和地址流水线
  7.7 构建完整的处理器
第8章 门级模型综合
  8.1 由半导体生产商提供的库
   8.1.1 逻辑门
   8.1.2 内部缓冲器
   8.1.3 触发器
   8.1.4 锁存器
   8.1.5 输入时钟驱动器
   8.1.6 输入缓冲器
   8.1.7 单向输出缓冲器 
   8.1.8 双向三态输出缓冲器 
   8.1.9 测试用宏单元
   8.1.10 宏单元:加法器
   8.1.11 宏单元:移位器
   8.1.12 宏单元:用户定义的RAM库
   8.1.13 自主开发的库单元:缓冲器
   8.1.14 自主开发的库单元: 触发器
   8.1.15 自主开发的库单元:多选器
  8.2 手工综合
   8.2.1 同步数据传输
   8.2.2 带组合逻辑的寄存器
   8.2.3 寄存器流水线
   8.2.4 多路数据选择器
   8.2.5 常数赋值
   8.2.6 变量赋值 
   8.2.7 行为级描述的间接综合
  8.3 工具自动综合
   8.3.1 综合工具
   8.3.2 逻辑综合的例子
  8.4 一个较大的综合实例
   8.4.1 同步数据传输器
   8.4.2 组合逻辑
   8.4.3 数据选择多选器
   8.4.4 间接综合
   8.4.5 变量赋值
  8.5 特殊情况: 异步总线协议
  8.6 统计数据和设计经验
  8.7 门级模型的仿真和优化
   8.7.1 验证
   8.7.2 优化
  8.7.3 时序仿真 
第9章 测试、可测性设计、测试仪以及测试板
  9.1 错误模型和错误覆盖率
  9.2 自动测试仪(ATE)
   9.2.1 测试仪的配置和操作
   9.2.2 格式和模版
  9.3 可测性设计
   9.3.1 用于存储器测试的多选器
   9.3.2 扫描通路
   9.3.3 信号分析
   9.3.4 半导体制造商的测试电路
  9.4 功能测试
  9.5 测试数据导出
   9.5.1 所需的测试方案和测试块
   9.5.2 三态、静态电流、工艺和存储器测试
   9.5.3 功能测试
   9.5.4 评估测试方案
   9.5.5 ATE测试数据的准备
  9.6 ATE测试仪
   9.6.1 DUT卡的设置
   9.6.2 开始测试
   9.6.3 测试结果
  9.7 测试板
   9.7.1 底板
   9.7.2 PC接口卡和总线接口卡 
   9.7.3 存储卡
   9.7.4 CPU卡
   9.7.5 评估
  9.8 结论
第10章 总结和展望
  10.1 效率和复杂度
  10.2 用状态图和转换图进行大型VLSI设计的设计描述、分析和仿真
  10.3 错误模型和HDL的测试方案
第11章 Verilog HDL建模 
  11.1 EBNF格式语法
  11.2 Verilog语句
   11.2.1 结构语句
   11.2.2 变量声明
   11.2.3 操作符
   11.2.4 程序控制
   11.2.5 其它语句
   11.2.6 VerilogXL 语句
  11.3 基本建模概念
   11.3.1 仿真器的并行执行原理和事件控制机制
   11.3.2 时序控制
   11.3.3 层次化建模和实例化
   11.3.4 行为和结构建模
   11.3.5 变量阵列
   11.3.6 模型和组
   11.3.7 双向通信
   11.3.8 一些实用编程指南
  11.4 实例
   11.4.1 简单的流水线
   11.4.2 复杂的流水线
   11.4.3 ASIC处理器的行为级模型
  11.4.4 ASIC处理器的结构化模型
11.5 语句的EBNF语法
 
版权所有:曙海信息网络科技有限公司 copyright 2000-2010
 
上海总部

地址:上海市真北路2500号星河世纪广场A座1904
(地铁11号线上海西站4号出口,家乐福桃浦路店旁)
邮编:200062
热线:021-51875830 32300767
传真:021-32300767
业务手机:15921673576/13918613812
E-mail:officeoffice@126.com
客服QQ: shuhaipeixun
北京分中心

地址:北京市昌平区沙河南街11号312室
(地铁昌平线沙河站B出口) 邮编:102200 行走路线:请点击这查看
热线:010-51292078 57292751
传真:010-51292078
业务手机:13661044276 15313032557
E-mail:officeoffice@126.com
客服QQ:1243285887
深圳分中心

地址:深圳市罗湖区桂园路2号电影大厦A座1816
(地铁一号线大剧院站D出口旁,桂园路和解放路交叉口,近地王大厦)
热线:0755-61280252 25912501
传真:0755-25912501
业务手机:13640932289
邮编:518001
信箱:qianru2@51qianru.cn
客服QQ:2472106501
南京分中心

地址:江苏省南京市栖霞区和燕路251号金港大厦B座2201室
(地铁一号线迈皋桥站1号出口旁,近南京火车站)
热线:4008699035
传真:025-84611061
业务手机:13851400109
邮编:210046
信箱:qianru3@51qianru.cn
客服QQ:973105434
 
成都分中心

地址:四川省成都市金牛区泰安里营门口路88号四威大厦1幢302 邮编:610031
热线:028-68802075 业务手机:13918613812 传真:028-68802075
客服QQ:973105434 E-mail:qianru4@51qianru.cn

武汉分中心

地址:湖北省武汉市江汉区新华路139号凯盟大厦401 邮编:430022
热线:027-50767718 业务手机:13657236279 传真:027-50767718
客服QQ:478681446 E-mail:qianru5@51qianru.cn

双休日、节假日及晚上可致电值班电话:021-51875830 值班手机:15921673576/13918613812


备案号:沪ICP备05030316号

.(2011年7月17日.................................................)...............................................................