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Be One Lab Functional Verification Methodology and Flow培训班
   入学要求

        学员学习本课程应具备下列基础知识:
        ◆ 电路系统的基本概念。

   班级规模及环境
       为了保证培训效果,增加互动环节,我们坚持小班授课,每期报名人数限5人,多余人员安排到下一期进行。
   上课时间和地点
上课地点:【上海总部】:同济大学(沪西)/星河世纪广场(11号线上海西站) 【深圳分部】:电影大厦(地铁一号线大剧院站)/深圳大学成教院 【北京分部】:北京中山/福鑫大楼 【南京分部】:金港大厦(和燕路) 【武汉分部】:凯盟大厦(新华路) 【成都分部】:四威大厦(泰安里营门口路)
近开课时间(周末班/连续班/晚班)
Lab Functional Verification:2012年7月7日....
   学时
     ◆课时: 共8天,64学时

        ◆外地学员:代理安排食宿(需提前预定)
        ☆合格学员免费颁发相关资格证书,提升您的职业资质
        作为早专注于嵌入式培训的专业机构,曙海嵌入式提供的证书得到本行业的广泛认
        可,学员的能力得到大家的认同

        ☆合格学员免费推荐工作
        ★实验设备请点击这儿查看★
   新优惠
       ◆团体报名优惠措施:两人95折优惠,三人或三人以上9折优惠 。注意:在读学生凭学生证,即使一个人也优惠500元。
   质量保障

        1、培训过程中,如有部分内容理解不透或消化不好,可免费在以后培训班中重听;
        2、培训结束后免费提供一个月的技术支持,充分保证培训后出效果;
        3、培训合格学员可享受免费推荐就业机会。

Be One Lab Functional Verification Methodology and Flow培训班
阶段一
  • What is functional verification and what is being verified 
    Formal Verification,Equivalence Checking,Model checking,
    Functional Verification,Test Bench Generation
  • Functional Verification Approaches
    Black-Box,White-Box,Grey-Box
  • The Verification Process
  • Specification and Test Plan ((Specification->Features->Test cases)
    Direct 、Direct-Random and Random Test Case
  • Advanced Verification Methodology
  • System//Chip/Module Level Verification
  • Behavioral Hardware Description Languages
  • Stimulus and Response
    Generating complex waveforms,Self-Checking test benches,Complex
    Response,Predicting the output
  • How to build reusable test bench
  • Test Bench Acceleration
  • Coverage Analysis in the Design Flow
  • Feature Coverage and Code Coverage (Line Condition Toggle FSM)
    Coding Guidelines
    Structure,Naming Convention,Comments,Syntax,Debugging
  • Simulation Management
    Modeling reset,Writing Good Behavioral Model,Regression Management

阶段二

  • Assertions Methodology
  • Formal Verification ((Design Rule Check)
  • Vector--based Verification
  • Memory Verification
  • Project Management and Verification Experience
    Introduce the useful verification experience that have been
    successfully used to produce one-passed ASICs,SoC,board,and
    entire systems.
  • Verisity 's Specman e language
  • Verisity 's e VC(e Verification Component)
  • Verisity 's e RM(e Reuse Methodlogy)

 

 
 
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.(2011年7月17日.................................................)...............................................................