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TMS320C6414 + XC2VP7

多功能板

【实物图片】


 
【主要特色】

l        采用TI公司C6x系列DSP中的TMS320C6414芯片,时钟频率为600M Hz(可升级为1GHz);

l        C6414片内自带提供8M bit程序和数据存储器,大部分的应用只需使用高速的片内存储器就可完成;

l        C6414EMIFA口全部数据、4根地址线、3个片选及读写信号引入了FPGA

l        C6414外部扩展128M bit SDRAM;

l        C6414外部扩展8M bit Flash Rom, 能将程序固化到Flash,并从Flash上电引导;

l        C6414提供2McBSP串口;

l        采用Xilinx公司Virtex2 Pro系列FPGA100万门的XC2VP7 –FG456芯片,片内资源非常丰富,Select Ram容量达576K bit,并且可配置成双口RAMFIFO,无需外部缓冲就可以实现高速数据采集;

l        FPGA内集成了强大的PowerPC CPU硬核,时钟频率300MHz;

l        FPGA可嵌入Xilinx公司MicroBlaze CPU软核及UARTI2CSDRAM控制器等多种IP核,实现系统芯片(SOC);

l        FPGA扩展128M bit SDRAM;

l        FPGA提供64个通用IO,其中32IO可配置成16LVDS差分;

l        LVDS差分传输速度可达800M bit/s,采用串行LVDS差分传输可大大减少并行传输所需的引线数目,降低噪声带来的误码;

l        FPGA扩展了一个RS232串口,一个4位的拨码开关,两个按钮和一个7段数码管;

l        采用了CYPRESS公司的128脚的CY7C68013 -128 USB2.0芯片;

l        68013芯片的数据、地址线全部引入FPGA,可以将FPGA片内的存储器映射为68013存储器,为固件提供更大的程序、数据空间;

l        68013芯片的Slave FIFO(GPIF)接口引入了FPGA;

l        68013芯片扩展了一个RS232串口,可对68013固件进行单步、断点调试

l        DSPPC机间通过USB接口高速通信,最高速率可达32M 字节/秒;


【演示例子】

1.     DSPPC机间高速通信

USB通过Slave FIFO接口向DSP发送一个命令包,该命令包写入FPGA内的输出FIFO,同时68013触发一个DSP中断;DSP响应中断,以DMA方式从FIFO读取命令包,执行相应的命令,以DMA方式将数据写入FPGA内的输入FIFOFPGA内的控制逻辑将数据从输入FIFO读出并写入68013芯片的内部FIFO

2.     FPGAPowerPC硬核工作演示

利用XILINX公司的嵌入式系统开发工具EDK7.1,在FPGA内集成了CPU硬核PowerPCSDRAM控制器、UART串口、定时器、数码管控制等IP核,可以通过串口和PC机通信,读写FPGA扩展的SDRAM,控制数码管显示等。

3.     LVDS串行传输演示

LVDS串行传输通过并串转换将并行数据串行化并通过LVDS差分方式高速传输,不仅大大减少了传输线数目而且提高了可靠性。举例说明:假设要传输的数据宽度是16位,时钟频率为10MHz,传统的并行传输方式需要 16位数据线 + 1位时钟 + 1位同步,共18对线;而串行传输方式通过提高传输频率和时钟上下沿同时传输的方式,只需1位数据线和1位时钟线,共2对线,时钟频率为80MHz

本演示需要两台PC机和两块开发板。PC1通过USB接口将图像数据发送到开发板1;开发板1完成并串转换将数据以LVDS串行差分方式发送到开发板2;开发板2进行串并转换通过USB接口把数据发送到PC2PC2显示接收到的图像数据。

4.     68013串口通信和断点、单步调试

通过68013的串口和PC机通信;下载监控程序实现对68013程序的断点、单步调试。

5.     DSP程序固化

DSP程序固化的Flash Rom中,实现上电引导。整个固化过程简单、快捷,不需要对源程序进行任何修改。
 

【提供资料】

1.     演示程序源代码

2.     电路板原理图(pdf格式)

3.     Xilinx FPGA开发工具ISE7.1

4.     Xilinx 嵌入式系统开发工具 EDK7.1

5.     TI DSP开发工具CCS3.1

6.   单片机开发工具Keil 7.02

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.(2014年7月11)..................................................................................................................